按照測(cè)試規(guī)范的要求,在發(fā)送信號(hào)質(zhì)量的測(cè)試中,只要有1個(gè)Preset值下能夠通過(guò)信 號(hào)質(zhì)量測(cè)試就算過(guò)關(guān);但是在Preset的測(cè)試中,則需要依次遍歷所有的Preset,并依次保存 波形進(jìn)行分析。對(duì)于PCIe3.0和PCIe4.0的速率來(lái)說(shuō),由于采用128b/130b編碼,其一致性測(cè)試碼型比之前8b/10b編碼下的一致性測(cè)試碼型要復(fù)雜,總共包含36個(gè)128b/130b的 編碼字。通過(guò)特殊的設(shè)計(jì), 一致性測(cè)試碼型中包含了長(zhǎng)“1”碼型、長(zhǎng)“0”碼型以及重復(fù)的“01” 碼型,通過(guò)對(duì)這些碼型的計(jì)算和處理,測(cè)試軟件可以方便地進(jìn)行預(yù)加重、眼圖、抖動(dòng)、通道損 耗的計(jì)算。 11是典型PCle3.0和PCIe4.0速率下的一致性測(cè)試碼型。PCIE物理層鏈路一致性測(cè)試狀態(tài)設(shè)計(jì);信息化PCI-E測(cè)試維修
關(guān)于各測(cè)試項(xiàng)目的具體描述如下:·項(xiàng)目2.1Add-inCardTransmitterSignalQuality:驗(yàn)證插卡發(fā)送信號(hào)質(zhì)量,針對(duì)2.5Gbps、5Gbps、8Gbps、16Gbps速率?!ろ?xiàng)目2.2Add-inCardTransmitterPulseWidthJitterTestat16GT/s:驗(yàn)證插卡發(fā)送信號(hào)中的脈沖寬度抖動(dòng),針對(duì)16Gbps速率。·項(xiàng)目2.3Add-inCardTransmitterPresetTest:驗(yàn)證插卡發(fā)送信號(hào)的Preset值是否正確,針對(duì)8Gbps和16Gbps速率?!ろ?xiàng)目2.4AddinCardTransmitterInitialTXEQTest:驗(yàn)證插卡能根據(jù)鏈路命令設(shè)置成正確的初始Prest值,針對(duì)8Gbps和16Gbps速率?!ろ?xiàng)目2.5Add-inCardTransmitterLinkEqualizationResponseTest:驗(yàn)證插卡對(duì)于鏈路協(xié)商的響應(yīng)時(shí)間,針對(duì)8Gbps和16Gbps速率。湖北P(pán)CI-E測(cè)試參考價(jià)格PCIE3.0和PCIE4.0應(yīng)該如何選擇?
PCIe4.0的測(cè)試夾具和測(cè)試碼型要進(jìn)行PCIe的主板或者插卡信號(hào)的一致性測(cè)試(即信號(hào)電氣質(zhì)量測(cè)試),首先需要使用PCIe協(xié)會(huì)提供的夾具把被測(cè)信號(hào)引出。PCIe的夾具由PCI-SIG定義和銷售,主要分為CBB(ComplianceBaseBoard)和CLB(ComplianceLoadBoard)。對(duì)于發(fā)送端信號(hào)質(zhì)量測(cè)試來(lái)說(shuō),CBB用于插卡的測(cè)試,CLB用于主板的測(cè)試;但是在接收容限測(cè)試中,由于需要把誤碼儀輸出的信號(hào)通過(guò)夾具連接示波器做校準(zhǔn),所以無(wú)論是主板還是插卡的測(cè)試,CBB和CLB都需要用到。
這么多的組合是不可能完全通過(guò)人工設(shè)置和調(diào)整 的,必須有一定的機(jī)制能夠根據(jù)實(shí)際鏈路的損耗、串?dāng)_、反射差異以及溫度和環(huán)境變化進(jìn)行 自動(dòng)的參數(shù)設(shè)置和調(diào)整,這就是鏈路均衡的動(dòng)態(tài)協(xié)商。動(dòng)態(tài)的鏈路協(xié)商在PCIe3.0規(guī)范中 就有定義,但早期的芯片并沒(méi)有普遍采用;在PCIe4.0規(guī)范中,這個(gè)要求是強(qiáng)制的,而且很 多測(cè)試項(xiàng)目直接與鏈路協(xié)商功能相關(guān),如果支持不好則無(wú)法通過(guò)一致性測(cè)試。圖4.7是 PCIe的鏈路狀態(tài)機(jī),從設(shè)備上電開(kāi)始,需要經(jīng)過(guò)一系列過(guò)程才能進(jìn)入L0的正常工作狀態(tài)。 其中在Configuration階段會(huì)進(jìn)行簡(jiǎn)單的速率和位寬協(xié)商,而在Recovery階段則會(huì)進(jìn)行更 加復(fù)雜的發(fā)送端預(yù)加重和接收端均衡的調(diào)整和協(xié)商。PCI-e硬件科普:PCI-e到底是什么?
測(cè)試類型8Gbps速率16Gbps速率插卡RX測(cè)試眼寬:41.25ps+0/—2ps眼寬:18.75ps+0.5/-0.5ps眼高:46mV+0/-5mV眼高:15mV+1.5/-1.5mV主板RX測(cè)試眼寬:45ps+0/-2ps眼寬:18.75ps+0.5/-0.5ps眼高:50mV+0/-5mV眼高:15mV+1.5/-1.5mV 校準(zhǔn)時(shí),信號(hào)的參數(shù)分析和調(diào)整需要反復(fù)進(jìn)行,人工操作非常耗時(shí)耗力。為了解決這個(gè) 問(wèn)題,接收端容限測(cè)試時(shí)也會(huì)使用自動(dòng)測(cè)試軟件,這個(gè)軟件可以提供設(shè)置和連接向?qū)?、控?誤碼儀和示波器完成自動(dòng)校準(zhǔn)、發(fā)出訓(xùn)練碼型把被測(cè)件設(shè)置成環(huán)回狀態(tài),并自動(dòng)進(jìn)行環(huán)回?cái)?shù) 據(jù)的誤碼率統(tǒng)計(jì)。圖4 . 18是典型自動(dòng)校準(zhǔn)和接收容限測(cè)試軟件的界面,以及相應(yīng)的測(cè)試PCI-E轉(zhuǎn)USB或UFS接口的控制芯片和測(cè)試板的制作方法;湖北P(pán)CI-E測(cè)試參考價(jià)格
所有帶pcie物理插槽的主板都可以插固態(tài)硬盤(pán)用么?假如能的話插上可以改成引導(dǎo)系統(tǒng)的盤(pán)么?信息化PCI-E測(cè)試維修
隨著數(shù)據(jù)速率的提高,芯片中的預(yù)加重和均衡功能也越來(lái)越復(fù)雜。比如在PCle 的1代和2代中使用了簡(jiǎn)單的去加重(De-emphasis)技術(shù),即信號(hào)的發(fā)射端(TX)在發(fā)送信 號(hào)時(shí)對(duì)跳變比特(信號(hào)中的高頻成分)加大幅度發(fā)送,這樣可以部分補(bǔ)償傳輸線路對(duì)高 頻成分的衰減,從而得到比較好的眼圖。在1代中采用了-3.5dB的去加重,2代中采用了 -3.5dB和-6dB的去加重。對(duì)于3代和4代技術(shù)來(lái)說(shuō),由于信號(hào)速率更高,需要采用更加 復(fù)雜的去加重技術(shù),因此除了跳變比特比非跳變比特幅度增大發(fā)送以外,在跳變比特的前 1個(gè)比特也要增大幅度發(fā)送,這個(gè)增大的幅度通常叫作Preshoot。為了應(yīng)對(duì)復(fù)雜的鏈路環(huán)境,信息化PCI-E測(cè)試維修
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