USB測(cè)試數(shù)字信號(hào)測(cè)試工廠直銷(xiāo)

數(shù)字信號(hào)的上升時(shí)間(Rising Time)

任何一個(gè)真實(shí)的數(shù)字信號(hào)在由一個(gè)邏輯電平狀態(tài)跳轉(zhuǎn)到另一個(gè)邏輯電平狀態(tài)時(shí),其中間的過(guò)渡時(shí)間都不會(huì)是無(wú)限短的。信號(hào)電平跳變的過(guò)渡時(shí)間越短，說(shuō)明信號(hào)邊沿越陡。我們通常使用上升時(shí)間(RisingTime)這個(gè)參數(shù)來(lái)衡量信號(hào)邊沿的陡緩程度，通常上升時(shí)間是指數(shù)字信號(hào)由幅度的10%增加到幅度的90%所花的時(shí)間(也有些場(chǎng)合會(huì)使用20%～80%的上升時(shí)間或其他標(biāo)準(zhǔn))。上升時(shí)間越短，說(shuō)明信號(hào)越陡峭。大部分?jǐn)?shù)字信號(hào)的下降時(shí)間(信號(hào)從幅度的90%下降到幅度的10%所花的時(shí)間)和上升時(shí)間差不多(也有例外)。圖1.2比較了兩種不同上升時(shí)間的數(shù)字信號(hào)。上升時(shí)間可以客觀反映信號(hào)邊沿的陡緩程度，而且由于計(jì)算和測(cè)量簡(jiǎn)單，所以得到的應(yīng)用。對(duì)有些非常高速的串行數(shù)字信號(hào)，如PCIe、USB3.0、100G以太網(wǎng)等信號(hào)，由于信號(hào)速率很高，傳輸線對(duì)信號(hào)的損耗很大，信號(hào)波形中很難找到穩(wěn)定的幅度10%和90%的位置，所以有時(shí)也會(huì)用幅度20%～80%的上升時(shí)間來(lái)衡量信號(hào)的陡緩程度。通常速率越高的信號(hào)其上升時(shí)間也會(huì)更陡一些(但不一定速率低的信號(hào)上升時(shí)間一定就緩),上升時(shí)間是數(shù)字信號(hào)分析中的一個(gè)非常重要的概念，后面我們會(huì)反復(fù)提及和用到這個(gè)概念。 數(shù)字信號(hào)可通過(guò)分時(shí)將大量信號(hào)合成為一個(gè)信號(hào)（稱復(fù)用信號(hào)），通過(guò)某個(gè)處理器處理后，再將信號(hào)解復(fù)用；USB測(cè)試數(shù)字信號(hào)測(cè)試工廠直銷(xiāo)

數(shù)字信號(hào)的時(shí)域和頻域

數(shù)字信號(hào)的頻率分量可以通過(guò)從時(shí)域到頻域的轉(zhuǎn)換中得到。首先我們要知道時(shí)域是真實(shí)世界，頻域是更好的用于做信號(hào)分析的一種數(shù)學(xué)手段，時(shí)域的數(shù)字信號(hào)可以通過(guò)傅里葉變換轉(zhuǎn)變?yōu)橐粋€(gè)個(gè)頻率點(diǎn)的正弦波的。這些正弦波就是對(duì)應(yīng)的數(shù)字信號(hào)的頻率分量。假如定義理想方波的邊沿時(shí)間為0,占空比50%的周期信號(hào)，其在傅里葉變換后各頻率分量振幅。

可見(jiàn)對(duì)于理想方波，其振幅頻譜對(duì)應(yīng)的正弦波頻率是基頻的奇數(shù)倍頻(在50%的占空比下)。奇次諧波的幅度是按1"下降的(/是頻率)，也就是-20dB/dec(-20分貝每十倍頻)。 USB測(cè)試數(shù)字信號(hào)測(cè)試工廠直銷(xiāo)什么是模擬信號(hào)？數(shù)字信號(hào)？

對(duì)于典型的3.3V的低電壓TTL(LVTTL)信號(hào)來(lái)說(shuō)，判決閾值的下限是0.8V,判決閾 值的上限是2.0V。正是由于判決閾值的存在，使得數(shù)字信號(hào)相對(duì)于模擬信號(hào)來(lái)說(shuō)有更高的 可靠性和抗噪聲的能力。比如對(duì)于3.3V的LVTTL信號(hào)來(lái)說(shuō)，當(dāng)信號(hào)輸出電壓為0V時(shí)， 只要噪聲或者干擾的幅度不超過(guò)0.8V,就不會(huì)把邏輯狀態(tài)由0誤判為1;同樣，當(dāng)信號(hào)輸出  電壓為3.3V時(shí)，只要噪聲或者干擾的幅度不會(huì)使信號(hào)電壓低于2.0V,就不會(huì)把邏輯狀態(tài)  由1誤判為0。

從上面的例子可以看到，數(shù)字信號(hào)抗噪聲和干擾的能力是比較強(qiáng)的。但也需要注意，這 個(gè)“強(qiáng)”是相對(duì)的，如果噪聲或干擾的影響使得信號(hào)的電壓超出了其正常邏輯的判決區(qū)間，數(shù)字信號(hào)也仍然有可能產(chǎn)生錯(cuò)誤的數(shù)據(jù)傳輸。在許多場(chǎng)合，我們對(duì)數(shù)字信號(hào)質(zhì)量進(jìn)行分析和 測(cè)試的基本目的就是要保證其信號(hào)電平在進(jìn)行采樣時(shí)滿足基本的邏輯判決條件。

數(shù)字信號(hào)的建立/保持時(shí)間(Setup/HoldTime)

不論數(shù)字信號(hào)的上升沿是陡還是緩，在信號(hào)跳變時(shí)總會(huì)有一段過(guò)渡時(shí)間處于邏輯判決閾值的上限和下限之間，從而造成邏輯的不確定狀態(tài)。更糟糕的是，通常的數(shù)字信號(hào)都不只一路，可能是多路信號(hào)一起傳輸來(lái)一些邏輯和功能狀態(tài)。這些多路信號(hào)之間由于電氣特性的不完全一致以及PCB走線路徑長(zhǎng)短的不同，在到達(dá)其接收端時(shí)會(huì)存在不同的時(shí)延，時(shí)延的不同會(huì)進(jìn)一步增加邏輯狀態(tài)的不確定性。

由于我們感興趣的邏輯狀態(tài)通常是信號(hào)電平穩(wěn)定以后的狀態(tài)而不是跳變時(shí)所的狀態(tài)，所以現(xiàn)在大部分?jǐn)?shù)字電路采用同步電路，即系統(tǒng)中有一個(gè)統(tǒng)一的工作時(shí)鐘對(duì)信號(hào)進(jìn)行采樣。如圖1.5所示，雖然信號(hào)在跳變過(guò)程中可能會(huì)有不確定的邏輯狀態(tài)，但是若我們只在時(shí)鐘CLK的上升沿對(duì)信號(hào)進(jìn)行判決采樣，則得到的就是穩(wěn)定的邏輯狀態(tài)。 數(shù)字信號(hào)上升時(shí)間是示波器中進(jìn)行上升時(shí)間測(cè)量例子，光標(biāo)交叉點(diǎn)指示出上升時(shí)間測(cè)量的起始點(diǎn)和結(jié)束點(diǎn)的位置；

抖動(dòng)的頻率范圍。抖動(dòng)實(shí)際上是時(shí)間上的噪聲，其時(shí)間偏差的變化頻率可能比較  快也可能比較慢。通常把變化頻率超過(guò)10Hz以上的抖動(dòng)成分稱為jitter,而變化頻率低于  10Hz的抖動(dòng)成分稱為wander(漂移)。wander主要反映的是時(shí)鐘源隨著時(shí)間、溫度等的緩  慢變化，影響的是時(shí)鐘或定時(shí)信號(hào)的***精度。在通信或者信號(hào)傳輸中，由于收發(fā)雙方都會(huì)  采用一定的時(shí)鐘架構(gòu)來(lái)進(jìn)行時(shí)鐘的分配和同步，緩慢的時(shí)鐘漂移很容易被跟蹤上或補(bǔ)償?shù)簦?因此wander對(duì)于數(shù)字電路傳輸?shù)恼`碼率影響不大，高速數(shù)字電路測(cè)量中關(guān)心的主要是高  頻的jitter。數(shù)字信號(hào)的波形分析（Waveform Analysis）;北京數(shù)字信號(hào)測(cè)試工廠直銷(xiāo)

數(shù)字信號(hào)處理中的基礎(chǔ)運(yùn)算；USB測(cè)試數(shù)字信號(hào)測(cè)試工廠直銷(xiāo)

很多經(jīng)典的處理器采用了并行的總線架構(gòu)。比如大家熟知的51單片機(jī)就采用了8根并行數(shù)據(jù)線和16根地址線；CPU的鼻祖——Intel公司的8086微處理器——**初推出時(shí)具有16根并行數(shù)據(jù)線和16根地址線；

現(xiàn)在很多嵌入式系統(tǒng)中多使用的ARM處理器則大部分使用32根數(shù)據(jù)線以及若干根地址線。并行總線的比較大好處是總線的邏輯時(shí)序比較簡(jiǎn)單，電路實(shí)現(xiàn)起來(lái)比較容易；但是缺點(diǎn)也是非常明顯的，比如并行總線的信號(hào)線數(shù)量非常多，會(huì)占用大量的引腳和布線空間，因此芯片和PCB的尺寸很難實(shí)現(xiàn)小型化，特別是如果要用電纜進(jìn)行遠(yuǎn)距離傳輸時(shí)，由于信號(hào)線的數(shù)量非常多，使得電纜變得非常昂貴和笨重。 USB測(cè)試數(shù)字信號(hào)測(cè)試工廠直銷(xiāo)

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