4.為了解決上述技術(shù)問題,本發(fā)明提供了一種ddr4內(nèi)存信號測試方法、裝置及存儲(chǔ)介質(zhì),可以反映正常工作狀態(tài)下的波形,可以提高測試效率。5.為實(shí)現(xiàn)上述目的,本技術(shù)提出技術(shù)方案:6.一種ddr4內(nèi)存信號測試方法,所述方法包括以下步驟:7.s1,將服務(wù)器、ddr4內(nèi)存和示波器置于正常工作狀態(tài),然后利用示波器采集ddr4內(nèi)存中的相關(guān)信號并確定標(biāo)志信號;8.s2,根據(jù)標(biāo)志信號對示波器進(jìn)行相關(guān)參數(shù)配置,利用示波器的觸發(fā)功能將ddr4內(nèi)存的信號進(jìn)行讀寫信號分離;9.s3,利用示波器對分離后的讀寫信號進(jìn)行測試。10.在本發(fā)明的一個(gè)實(shí)施例中,所述將服務(wù)器、ddr4內(nèi)存和示波器置于正常工作狀態(tài),然后利用示波器采集ddr4內(nèi)存中的相關(guān)信號并確定標(biāo)志信號,具體包括:11.將示波器與ddr4內(nèi)存的相關(guān)信號引腳進(jìn)行信號連接;12.將服務(wù)器、ddr4內(nèi)存和示波器置于正常工作狀態(tài);13.利用示波器對ddr4內(nèi)存的相關(guān)信號進(jìn)行采集并根據(jù)相關(guān)信號的波形確定標(biāo)志信號。DDR規(guī)范里關(guān)于信號建立;DDR測試DDR測試規(guī)格尺寸
DDR測試
主要的DDR相關(guān)規(guī)范,對發(fā)布時(shí)間、工作頻率、數(shù)據(jù) 位寬、工作電壓、參考電壓、內(nèi)存容量、預(yù)取長度、端接、接收機(jī)均衡等參數(shù)做了從DDR1 到 DDR5的電氣特性詳細(xì)對比??梢钥闯鯠DR在向著更低電壓、更高性能、更大容量方向演 進(jìn),同時(shí)也在逐漸采用更先進(jìn)的工藝和更復(fù)雜的技術(shù)來實(shí)現(xiàn)這些目標(biāo)。以DDR5為例,相 對于之前的技術(shù)做了一系列的技術(shù)改進(jìn),比如在接收機(jī)內(nèi)部有均衡器補(bǔ)償高頻損耗和碼間 干擾影響、支持CA/CS訓(xùn)練優(yōu)化信號時(shí)序、支持總線反轉(zhuǎn)和鏡像引腳優(yōu)化布線、支持片上 ECC/CRC提高數(shù)據(jù)訪問可靠性、支持Loopback(環(huán)回)便于IC調(diào)測等。 DDR測試DDR測試規(guī)格尺寸DDR壓力測試的內(nèi)容方案;
DDR測試
什么是DDR?
DDR是雙倍數(shù)據(jù)速率(DoubleDataRate)。DDR與普通同步動(dòng)態(tài)隨機(jī)內(nèi)存(DRAM)非常相象。普通同步DRAM(現(xiàn)在被稱為SDR)與標(biāo)準(zhǔn)DRAM有所不同。標(biāo)準(zhǔn)的DRAM接收的地址命令由二個(gè)地址字組成。為節(jié)省輸入管腳,采用了復(fù)用方式。地址字由行地址選通(RAS)鎖存在DRAM芯片。緊隨RAS命令之后,列地址選通(CAS)鎖存第二地址字。經(jīng)過RAS和CAS,存儲(chǔ)的數(shù)據(jù)可以被讀取。同步動(dòng)態(tài)隨機(jī)內(nèi)存(SDRDRAM)將時(shí)鐘與標(biāo)準(zhǔn)DRAM結(jié)合,RAS、CAS、數(shù)據(jù)有效均在時(shí)鐘脈沖的上升邊沿被啟動(dòng)。根據(jù)時(shí)鐘指示,可以預(yù)測數(shù)據(jù)和其它信號的位置。因而,數(shù)據(jù)鎖存選通可以精確定位。由于數(shù)據(jù)有效窗口的可預(yù)計(jì)性,所以可將內(nèi)存劃分成4個(gè)組進(jìn)行內(nèi)部單元的預(yù)充電和預(yù)獲取。通過突發(fā)模式,可進(jìn)行連續(xù)地址獲取而不必重復(fù)RAS選通。連續(xù)CAS選通可對來自相同行的數(shù)據(jù)進(jìn)行讀取。
對于DDR2和DDR3,時(shí)鐘信號是以差分的形式傳輸?shù)?,而在DDR2里,DQS信號是以單端或差分方式通訊取決于其工作的速率,當(dāng)以高度速率工作時(shí)則采用差分的方式。顯然,在同樣的長度下,差分線的切換時(shí)延是小于單端線的。根據(jù)時(shí)序仿真的結(jié)果,時(shí)鐘信號和DQS也許需要比相應(yīng)的ADDR/CMD/CNTRL和DATA線長一點(diǎn)。另外,必須確保時(shí)鐘線和DQS布在其相關(guān)的ADDR/CMD/CNTRL和DQ線的當(dāng)中。由于DQ和DM在很高的速度下傳輸,所以,需要在每一個(gè)字節(jié)里,它們要有嚴(yán)格的長度匹配,而且不能有過孔。差分信號對阻抗不連續(xù)的敏感度比較低,所以換層走線是沒多大問題的,在布線時(shí)優(yōu)先考慮布時(shí)鐘線和DQS。DDR規(guī)范里關(guān)于信號建立保持是的定義;
DDR測試
DDR的信號仿真驗(yàn)證由于DDR芯片都是采用BGA封裝,密度很高,且分叉、反射非常嚴(yán)重,因此前期的仿真是非常必要的。是借助仿真軟件中專門針對DDR的仿真模型庫仿真出的通道損耗以及信號波形。仿真出信號波形以后,許多用戶需要快速驗(yàn)證仿真出來的波形是否符合DDR相關(guān)規(guī)范要求。這時(shí),可以把軟件仿真出的DDR的時(shí)域波形導(dǎo)入到示波器中的DDR測試軟件中,并生成相應(yīng)的一致性測試報(bào)告,這樣可以保證仿真和測試分析方法的一致,并且便于在仿真階段就發(fā)現(xiàn)可能的信號違規(guī)。 DDR2總線上的信號波形;DDR測試DDR測試規(guī)格尺寸
DDR4信號完整性測試案例;DDR測試DDR測試規(guī)格尺寸
DDR測試
要注意的是,由于DDR的總線上存在內(nèi)存控制器和內(nèi)存顆粒兩種主要芯片,所以DDR的信號質(zhì)量測試?yán)碚撋弦矐?yīng)該同時(shí)涉及這兩類芯片的測試。但是由于JEDEC只規(guī)定了對于內(nèi)存顆粒這一側(cè)的信號質(zhì)量的要求,因此DDR的自動(dòng)測試軟件也只對這一側(cè)的信號質(zhì)量進(jìn)行測試。對于內(nèi)存控制器一側(cè)的信號質(zhì)量來說,不同控制器芯片廠商有不同的要求,目前沒有統(tǒng)一的規(guī)范,因此其信號質(zhì)量的測試還只能使用手動(dòng)的方法。這時(shí)用戶可以在內(nèi)存控制器一側(cè)選擇測試點(diǎn),并借助合適的信號讀/寫分離手段來進(jìn)行手動(dòng)測試。 DDR測試DDR測試規(guī)格尺寸
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